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摘要:本发明提供的技术方案,所述基于FPGA的小波变换实现结构包括:输入多路复用器、提升滤波器模块、配置寄存器、可配置的交叉开关单元、反馈延时组、延时寄存器组、地址发生器,提升滤波器模块的操作由配置寄存器来控制,所述输入多路复用器的输出端依次连接可配置的交叉开关单元、提升滤波器模块、延时寄存器组,地址发生器的输出端连接输入多路复用器和反馈延时组。本发明的优点是:将小波变换算法用硬件描述语言(HDL)在FPGA上实现,大大降低了复杂性,从而减少芯片面积和功耗。FPGA则可以通过并行和流水线设计实现高速的信号处理,且具有可重构能力,满足了数字信号处理的实时性要求。